Interrupciones y fusibles Microcontroladores

FUSIBLES E INTERRUPCIONES I. OBJETIVOS: Objetivo General: Conocer sobre cada fusible e interruptor que tiene el PIC 16f887 y el 18f4550 para determinación de cual se utiliza para un mejor funcionamiento de los mismos. Objetivos Específicos: Conocer la descripción de los fusibles y las interrupciones para los PIC´s 16f887 y 18f4550. Determinar fusibles e interrupciones diferentes entre los PICS 16f887 y 18f4550. II. INTRODUCCIÓN: FUSIBLES: 1) Según Fernando E. Valdés Pérez y Ramón Pallás Areny en su libro “MICROCONTROLADORES: “MICROCONTROLADORES: FUNDAMENTOS Y APLICACIONES CON PIC”: Los Fusibles Son configuraciones de la forma de funcionamiento del microcontrolador, se transfieren al PIC cada vez que se graba un programa. 2) Según Armando Astarloa Cuéllar y Aizol Zuloaga Izaguierreen su libro “SISTEMAS DE PROCESAMIENTO DIGITAL”: Los bit's de configuración o más comúnmente llamados "fusibles" permiten configurar ciertas funciones en los microcontroladores PIC, como el tipo de cristal para el oscilador, permiten proteger el código en el micro, entre muchas funciones. La cantidad de funciones que se pueden configurar con los fusibles dependen del microcontrolador, si tenemos en el 16F84A 4 funciones, en el 16F88 son alrededor de 13 funciones. 3) Según Cánovas Andrés en su documento Manual CCS Español alojado en Scribd.com: Los Scribd.com: Los fusibles se utilizan para configurar parámetros importantes del sistema. A diferencia de los registros de configuración, estos fusibles están relacionados con aspectos más básicos e importantes en el funcionamiento del sistema (por ejemplo, los bits de fusible de la fuente de reloj, que le permiten especificar el origen y/o la velocidad de reloj del chip). Además, su configuración queda grabada en memoria Flash, de forma tal que no se pierda al cortar la alimentación al microcontrolador. 





Ejemplos: # FUSES LP # FUSES XT # FUSES HS # FUSES RC # FUSES WDT

Low Power Cristal Oscilator ≤ 4Mhz. High Speed Oscilator >4Mhz. Montaje Resistencia Condensador. Watch Dog Timer Activo

UNIVERSIDAD TÉCNICA DE AMBATO FACULTAD DE INGENIERÍA EN SISTEMAS, ELECTRÓNICA E INDUSTRIAL CARRERA DE ELECTRÓNICA Y COMUNICACIONES

# FUSES NOWDT # FUSES PROTECT # FUSES NOPROTECT # FUSES PUT

No Watch Dog Timer. Proteccion de Lectura. No Proteccion de Lectura. Power Up Timer. Tabla2.1: Ejemplos de fusibles.

INTERRUPCIONES: 4) Según Fernando E. Valdés Pérez y Ramón Pallás Areny en su libro “MICROCONTROLADORES: FUNDAMENTOS Y APLICACIONES CON PIC”:

Una solicitud de interrupción o simplemente una interrupción es un evento de origen interno o externo que, si es atendido, hace que el microcontrolador interrumpa la ejecución del programa en curso y en su lugar ejecute las interrupciones de otro programa. Normalmente, cuando el programa que atiende la solicitud de interrupciones ha completado su ejecución, el microcontrolador continua con las instrucciones del programa interrumpido, justo con la instrucción que sigue a la que se estaba ejecutando cuando se produjo la solicitud de interrupción.

Figura 2.4.1: Cuando se produce una solicitud de interrupción y ésta es atendida por el microcontrolador, se termina la ejecución de la instrucción en curso y se salta al programa de atención a dicha solicitud de interrupción. Concluido éste, continúa la ejecución de las l as instrucciones del programa interrumpido.4 5) Según Cánovas Andrés en su documento Manual CCS Español alojado en Scribd.com: Las Scribd.com: Las interrupciones son un mecanismo por el que un dispositivo, ante la ocurrencia de un evento, pide al procesador que interrumpa el programa que se está ejecutando y pase a ejecutar temporalmente una subrutina especifica. Esta subrutina recibe el nombre de rutina de atención a interrupción. Cuando el microcontrolador recibe una señal de interrupción, el contador de programa apunta a la dirección 04H de la memoria de programa, por eso, allí se debe escribir toda la programación necesaria para atender dicha interrupción. 6) Según Armando Astarloa Cuéllar y Aizol Zuloaga Izaguierreen su libro “SISTEMAS DE PROCESAMIENTO DIGITAL”: Las interrupciones permiten a cualquier suceso interior interior o exterior interrumpir interrumpir la ejecución ejecución del programa principal en cualquier momento. En el momento de producirse, el PIC

SÉPTIMO ELECTRÓNICA “A” “A”

MICROCONTROLADORES


ejecuta un salto a la rutina de atención a la interrupción previamente definida por el programador, donde se atenderá a la demanda de la interrupción. Ejemplos: Interrupciones #INT_AD #INT_ADOF #INT_BUSCOL #INT_BUTTON #INT_CAERR #INT_CANIRX #INT_CANRX0 #INT_CANRX1 Interrupciones #INT_AD #INT_ADOF #INT_BUSCOL #INT_BUTTON #INT_CAERR #INT_CANIRX #INT_CANRX0 #INT_CANRX1

Descripción Conversión AD completa. Conversión AD fuera de rango de tiempo Colisión de bus Por botón (14000) Erro en el módulo CAN Mensaje invalido n el bus CAN Bus CAN recibe un nuevo mensaje en buffer 0 Bus CAN recibe un nuevo mensaje en buffer 1 Descripción Conversión AD completa. Conversión AD fuera de rango de tiempo Colisión de bus Por botón (14000) Erro en el módulo CAN Mensaje invalido n el bus CAN Bus CAN recibe un nuevo mensaje en buffer 0 Bus CAN recibe un nuevo mensaje en buffer 1 Tabla 2.6.1: Ejemplos de interrupciones.

FUSIBLES DEL PIC 16F887 DIFERENTES AL PIC 18F4550 Los “FUSIBLES” o “BITS DE CONFIGURACION” se pueden programar, o dejar sin programar para activar o desactivar ciertas características especiales del microcontrolador. Estos bits son asignados en el PIC 16F887 en las posiciones 2007h y 2008h de la memoria de programa respectivamente. NOMBRE DE FUSIBLE CP

PWRTE

DESCRIPCIÓN

FUNCIÓN

PIC

Code Protection – Este fusible si está habilitado en 16f887 Codigo de Proteccion de ON evita que otras personas Programa puedan leer el programa contenido en el PIC Config 1 = Program memory code protection is disabled 0 = Program memory code protection is enabled Power-up Timer Enable Este fusible se utiliza para 16f887 – Bit de Permiso para el resetear el PIC cada vez que se Timer de Alimentación conecta a la fuente de alimentación de la aplicación a usarse.

SÉPTIMO ELECTRÓNICA “A”

MICROCONTROLADORES


WDTE

FOSC<2:0>

Config 1 = PWRT disabled 0 = PWRT enabled Watchdog Timer Enable Este fusible temporizador 16f887 – Temporizador de resetea el PIC cada cierto Perro Guardián tiempo para evitar enciclamientos por error en el programa. Config 1 = WDT enabled 0 = WDT disabled (pudiendo ser habilitado por SWDTEN bit del resgistro WDTCON) Bits de Selección del Este fusible define la función 16f887 Oscilador. de los terminales A6 y A7. Ya

sea como puertos I/O, como pines para cristal externo o para recibir o emitir señales de reloj. Se comporta de acuerdo a: 111: Oscillator RC 110: RC I/O oscillator 101: INTOSC oscillator 100: INTOSCIO oscllator 011: EC: I/O 010: HS oscillator 001: XT oscillator 000: LP oscillator WRT <1:0>

Flash Program Memory Self Write Enable bits o bits de habilitación de auto escritura de la memoria flash de programa.

Protege la memoria de programa contra escritura de la siguiente manera: 00: 0000h to 0FFFh 01: 0000h to 07FFh 10: 0000h to 00FFh 11: writte protection off

16F887

BOR4V

Brown-out Selection bit

Reset Permite configurar el nivel

16f887

de voltaje del reset o de escritura de la siguiente manera: 0: setea en 2.1 v 1: setea en 4 v Figura 2.1: Fusibles Del Pic 16f887 Diferentes Al Pic 18f4550

FUSIBLES DEL PIC 18F4550 DIFERENTES AL PIC 16F887 Los fusibles o también conocidos como bits de configuración (BIT'S DE CONFIGURACIÓN) permite configurar ciertas funciones de los microcontroladores


MICROCONTROLADORES


como el tipo de oscilador, habilitar reset, bajo voltaje en el oscilador, y otros; Los cuales se detalla los fusibles del PIC 18F4550 diferentes al PIC 16F887. NOMBRE DE FUSIBLE DESCRIPCIÓN CCP2 MUX bit El bit de configuración CCP2 MUX determina qué pin CCP2 es multiplexado. Por defecto, se le asigna a RC1 (CCP2MX = 1) y si el bit de configuración se borra, CCP2 se multiplexa con RB3. PLL Prescaler Este fusible funciona Selection como un multiplexor. La finalidad es obtener una frecuencia de 4MHz para el circuito.

System Clock Este fusible es el Postscaler Selection encargado de hacer la división de frecuencia tanto de la señal de entrada 96MHz o del cristal u oscilador de entrada.

PORTB A/D

FUNCIÓN Pertenece al módulo Capture/Compare/P WM

PIC 18f4550

La función de este Fuse es dividir la frecuencia de entrada del Oscilador (OS1 y OS2) a las siguientes escalas: /No divide (1), /2, /3, /4, /5, /6, /10, /12. En los dos casos se puede realizar diferentes divisiones de oscilador para de esta manera no solo obtener una frecuencia de 4MHz sino con otros valores. Esta función habilita o no la conversión Analógica-Digital.

18f4550

Si uno requiere hacerlo manualmente debe de configurar los registros ADCON o ANSEL correspondientes en el MCU. USBDIV: USB Clock Permite realizar una Este fuse configura Selection bit configuración para el de donde proviene oscilador. la velocidad de reloj para el Módulo USB. VREGEN: USB Modifica el voltaje Este habilita o SÉPTIMO ELECTRÓNICA “A”

18f4550

18f4550

18f4550

18f4550

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Internal Voltage del USB Regulator Enable bit

deshabilita la utilización del regulador interno del Vbus para el USB. WDTPS3: Configuración del Selección de bits WDTPS0:Watchdog wach dog. para la configuración Timer Postscale del Watchdog Timer Select bits y para ello debe de habilitar el uso de este. Low-Power Timer 1 Establece en nivel de Cuando se establece 18f4550 Oscillator voltaje en la el bit de configuración del configuración Timer 1, ya que este LPT1OSC, el puede funcionar en oscilador Timer1 dos diferentes opera en un modo niveles de consumo de bajo consumo y de energía cuando LPT1OSC no está establecido, Timer1 opera a un nivel de potencia más alto STVREN: Stack Permite el reinicio Si está activo por 18f4550 Full/Underflow Reset del dispositivo. causa de un Enable bit subdesbordamiento restablece el dispositivo de lo contrario las condiciones de subdesbordamiento no restablecen el dispositivo. ICPRT: Dedicated In- Configuración del Con este fusible se 18f4550 Circuit puerto de activa o desactiva el Debug/Programming .programación puerto de Puede Port (ICPORT) Enable configurar el puerto bit terminal del programa para enviar y recibir datos seriales. Tabla 2.2: Fusibles Del Pic 18f4550 Diferentes Al Pic 16f887 FUSIBLES IGUALES ENTRE 16F887 Y 18F4550 Los fusibles o también conocidos como bits de configuración (BIT'S DE CONFIGURACION) permiten configurar ciertas funciones de los microcontroladores SÉPTIMO ELECTRÓNICA “A”

MICROCONTROLADORES


como el tipo de oscilador, la protección de código, habilitar el perro guardián, habilitar el reset maestro, habilitar un reset inicial, habilitar reset por bajo voltage en la fuente, y otros. FUSIBLES

DESCRIPCION

FUNCION

MASTER CLEAR

RESETEA EL MICROCONTROLAD OR VISUALIZA LOS FALLOS OCURRIDOS EN EL PIC PROTEJE EL CODICO DEL MICROCONTROLAD OR DEPURACIÓN PARA ICD (SERIE).

MCLRE

FCMEN

CPD

DATA EEPROM CODE PROTECTION BIT

DEBUG

BACKGROUND DEBUGGER ENABLE BIT

IESO

FOSC -

FAIL-SAFE CLOCK MONITOR ENABLE BIT

INTERNAL/EXTERNAL OSCILLATOR SWITCHOVER BIT OSCILLATOR SELECTION BITS HS LP XT EC

-

-

-

WDT

HIGH-SPEED CRYSTAL/RESONA TOR OSCILLATOR: LOW-POWER CRYSTAL ON CRYSTAL/RESONA TOR EXTERNAL CLOCK WITH FOSC/4 OUTPUT

WATCHDOG TIMER


CONMUTACIÓN INTERNO EXTERNO

ESTABLECE LA OSCILACION DEL CIRCUITO

ROMPE LOS BUCLES INFINITOS

INSTRUCCIONES PARA ACTIVAR/DESACTIV AR #FUSES MCLR #FUSES FCMEN

#FUSES NOCPD #FUSES CPD

#FUSES NODEBUG #FUSES DEBUG

#FUSES IESO #FUSES NOIESO

#FUSES HS_OSC #FUSES XT_OSC #FUSES LP_OSC #FUSES EC_OSC

#FUSES NOWDT #FUSES WDT

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LVP

ESTABLECE LA LOW-VOLTAGE ICSP PROGRAMACION EN #FUSES NOLVP PROGRAMMING BAJA TENSIÓN DE #FUSES LVP PROGRAMACIÓN EN B3 (PIC16) O B5 (PIC18) Figura 2.3: Fusibles Iguales Entre 16f887 Y 18f4550

INTERRUPCIONES DEL PIC 16F887 DIFERENTES AL PIC 18F4550: Registro INTCON El registro INTCON contiene varios bits de habilitación y de bandera para el desbordamiento en el registro TMR0, e interrupciones por el cambio del estado en el puerto PORTB y las interrupciones externas en el pin INT. R/W(0) R/W(0) R/W(0) R/W(0) R/W(0) R/W(0) R/W(0) R/W(X) CARACTERISTICAS INTCON

GIE

PEIE

T0IE

INTE

RBIE

T0IF

INTF

RBIF

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

NOMBRE DE BIT

R/W bit de lectura/escritura (0) Despues del reinicio, el bit se pone a cero (x) Después del reinicio, el estado de bit es desconocido 





GIE - Global Interrupt Enable bit Bit de habilitación de interrupciones globales Controla simultáneamente todas las fuentes de interrupciones posibles. 1= Habilita las interrupciones no enmascaradas. 0= Deshabilita las interrupciones no enmascaradas. PEIE - Perip=heral Interrupt Enable bit Bit de habilitación de interrupciones periféricas Es similar al bit GIE, sin embargo controla interrupciones habilitadas por los periféricos. Eso significa que no influye en interrupciones causadas por el temporizador Timer0 o por el cambio del estado en el puerto PORTB o por el cambio en el pin RB0/INT. 1= Habilita las interrupciones periféricas no enmascaradas. 0= Deshabilita las interrupciones periféricas no enmascaradas. T0IE - TMR0 Overflow Interrupt Enable bit Bit de habilitación de interrupciones por el desbordamiento del temporizador Timer0 controla interrupciones causadas por el desbordamiento del Timer0.


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









1= Habilita interrupciones por Timer0. 0= Deshabilita interrupciones por Timer0. INTE - RB0/INT External Interrupt Enable bit Bit de habilitación de la interrupción externa en RB0 Controla interrupciones causadas por el cambio del estado lógico en el pin de entrada RB0/INT (interrupción externa). 1= Habilita interrupciones externas INT. 0= Deshabilita interrupciones externas INT. RBIE - RB Port Change Interrupt Enable bit Bit de habilitación de interrupciones por cambios en el puerto PORTB. Cuando se configuran como entradas, los pines en el puerto PORTB pueden causar una interrupción al cambiar el estado lógico (no importa si se produce bajada o subida de tensión, lo que importa es que se produce un cambio). Este bit determina si una interrupción va a ocurrir. 1= Habilita interrupciones por cambio en el puerto PORTB. 0= Deshabilita interrupciones por cambio en el puerto PORTB. T0IF - TMR0 Overflow Interrupt Flag bit Bit de bandera de interrupción por el desbordamiento del Timer0 Detecta el desbordamiento en el registro del temporizador Timer0, o sea el contador se pone a cero. 1= En el registro del Timer0 ha ocurrido desbordamiento (esta bandera debe volverse a 0 por software). 0= En el registro del Timer0 no ha ocurrido desbordamiento. INTF - RB0/INT External Interrupt Flag bit Bit de bandera de interrupción externa en INT Detecta el cambio en el estado lógico en el pin INT. 1= Ha ocurrido una interrupción externa por INT (esta bandera debe volverse a 0 por software) 0= No ha ocurrido una interrupción externa por INT. RBIF - RB Port Change Interrupt Flag bit Bit de bandera de interrupción por cambio en el puerto RB Detecta cualquier cambio del estado lógico de alguno de los pines de entrada en el puerto PORTB. 1= Al menos uno de los pines de E/S de propósito general en el puerto PORTB ha cambiado de valor. Después de leer el puerto PORTB, el bit RBIF debe volverse a 0 por software. 0= Ninguno de los pines de E/S de propósito general en el puerto PORTB ha cambiado de valor.

Registro PIE1 El registro PIE1 contiene los bits de habilitación de interrupciones periféricas.

PIE1

-

R/W(0)

R/W(0)

R/W(0)

R/W(0)

R/W(0)

R/W(0)

R/W(0)

Características

ADIE

RCIE

TXIE

SSPIE

CCP1IE

TMR2IE

TMR1IE

Nombre de bit


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Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

-Bit no implementado R/W Bit de lectura/escritura (0)Despues del reinicio, el bit se pone a cero ADIE - A/D Converter Interrupt Enable bit Bit de habilitación de interrupciones del convertidor A/D. 1 - Habilita la interrupción ADC. 0 - Deshabilita la interrupción ADC. RCIE - EUSART Receive Interrupt Enable bit Bit de habilitación de interrupciones de recepción del EUSART. 1 - Habilita la interrupción de recepción del EUSART. 0 - Deshabilita la interrupción de recepción del EUSART. TXIE - EUSART Transmit Interrupt Enable bit Bit de habilitación de interrupciones de transmisión del EUSART. 1 - Habilita la interrupción de transmisión del EUSART. 0 - Deshabilita la interrupción de transmisión del EUSART. SSPIE - Master Synchronous Serial Port (MSSP) Interrupt Enable bit Bit de habilitación de la interrupción del puerto serie síncrono maestro (MSSP) Habilita generar una petición de interrupción después de cada transmisión de datos por el módulo de comunicación serie síncrona (modo SPI o I2C). 1 - Habilita la interrupción del MSSP. 0 - Deshabilita la interrupción del MSSP. CCP1IE - CCP1 Interrupt Enable bit Bit de habilitación de la interrupción del módulo 1 de Comparación/Captura/PWM - CCP1 Permite generar una petición de interrupción en el módulo CCP1 utilizado para procesamiento de la señal PWM. 1 - Habilita la interrupción CCP1. 0 - Deshabilita la interrupción CCP1. TMR2IE - TMR2 to PR2 Match Interrupt Enable bit Bit de habilitación de la interrupción de igualdad entre TMR2 y PR2. 1 - Habilita la interrupción de igualdad entre TMR2 y PR2. 0 - Deshabilita la interrupción de igualdad entre TMR2 y PR2. TMR1IE - TMR1 Overflow Interrupt Enable bit Bit de habilitación de la interrupción de desbordamiento del temporizador Timer1 Habilita generar una petición de interrupción después de cada desbordamiento en el registro del temporizador Timer1, o sea el contador se pone a cero. 1 - Habilita la interrupción de desbordamiento del temporizador Timer1. 0 - Deshabilita la interrupción de desbordamiento del temporizador Timer1. Registro PIE2: El registro PIE2 también contiene varios bits de habilitación de interrupciones. 














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R/W(0) R/W(0) R/W(0) R/W(0) R/W(0) R/W(0) Características PIE2 OSFIE C2IE C1IE EEIE BCLIE ULPWUIE CCP2IE Nombre de Bit Bit7 Bit6 Bit5 Bit4 Bit3 Bit2 Bit1 Bit0 Leyenda: Bit no implementado R/W Bit de escritura /lectura (0) Después del reinicio el bit se pone a cero



OSFIE - Oscillator Fail Interrupt Enable bit (bit de habilitación de la interrupción de fallo en el oscilador) 1 - Habilita la interrupción de fallo en el oscilador. 0 - Deshabilita la interrupción de fallo en el oscilador. o o



C2IE - Comparator C2 Interrupt Enable bit (bit de habilitación de la interrupción del comparador C2) 1 - Habilita la interrupción del comparador C2. 0 - Deshabilita la interrupción del comparador C2. o o



C1IE - Comparator C1 Interrupt Enable bit (bit de habilitación de la interupción del comparador C1) 1 - Habilita la interrupción del comparador C1 0 - Deshabilita la interrupción del comparador C1. o o



EEIE - EEPROM Write Operation Interrupt Enable bit (bit de habilitación de la interrupción de escritura en la memoria EEPROM) 1 - Habilita la interrupción de escritura en la memoria EEPROM. 0 - Deshabilita la interrupción de escritura en la memoria EEPROM. o o



BCLIE - Bus Collision Interrupt Enable bit (bit de habilitación de la interrupción de colisión de bus) 1 - Habilita la interrupción de colisión de bus. 0 - Deshabilita la interrupción de colisión de bus. o o



ULPWUIE - Ultra Low-Power Wake-up Interrupt Enable bit (bit de habilitación de la interrupción para salir del modo de ultra bajo consumo - la reactivación) 1 - Habilita la interrupción para salir del modo de ultra bajo consumo. 0 - Deshabilita la interrupción para salir del modo de ultra bajo consumo. o o



CCP2IE - CCP2 Interrupt Enable bit (bit de habilitación de la interrupción del módulo 2 de Comparación/Captura/PWM (CCP2) 1 - Habilita la interrupción del CCP2. 0 - Deshabilita la interrupción del CCP2. o o


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Pasando a mikroc nos queda: // Inicio de la rutina de interrupción void interrupt() { PORTB.F1 = ~PORTB.F1 ; // La interrupción invertirá el estado lógico del // pin PORTB.1 PIR2.C2IF = 0; // Bit de bandera de interrupción C2IF se pone a cero } // Final de la rutina de interrupción

void main() { TRISB = 0;

// Todos los pines del puerto PORTB se configuran // como salidas // El pin PORTB.1 se pone a uno PORTB.F1 = 1; ANSEL = 0b00000101;; // Los pines RA0/C12IN0- y RA2/C2IN+ son las // entradas analógicas // Todos los pines de E/S se configuran como digitales ANSELH = 0; CM2CON0.C2CH0 = CM2CON0.C2CH1 = 0; // El pin RA0 se selecciona para ser una // entrada invertida del C2 PIE2.C2IE = 1; // Habilita la interrupción del comparador C2INT CON.GIE = 1; // Interrupción global está habilitada CM2CON0.C2ON = 1; // Comparador C2 está habilitado

... ...

Registro PIR1: El registro PIR1 contiene los bits de banderas de interrupción.

PIR1

Bit7

R/W(0) R(0) ADIF RCIF Bit6 Bit5

R(0) TXIF Bit4

R/W(0) R/W(0) SSPIF CCP1IF Bit3 Bit2

R/W(0) R/W(0) Características TMR2IF TMR1IF Nombre de Bit Bit1 Bit0

Leyenda: Bit no implementado R/W Bit de lectura/escritura R Bit de lectura (0) Después del reinicio, el Bit se pone a cero



ADIF - A/D Converter Interrupt Flag bit (bit de bandera de la interrupción del convertidor A/D) 1 - Se ha completado una conversión A/D (el bit debe volverse a 0 por software) 0 - No se ha completado una conversión A/D o no ha empezado o

o


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UNIVERSIDAD TÉCNICA DE AMBATO FACULTAD DE INGENIERÍA EN SISTEMAS, ELECTRÓNICA E INDUSTRIAL CARRERA DE ELECTRÓNICA Y COMUNICACIONES 

RCIF - EUSART Receive Interrupt Flag bit (bit de bandera de la interrupción de recepción del EUSART) 1 - El búfer de recepción del EUSART está lleno. El bit se pone a cero al leer el registro RCREG. 0 - El búfer de recepción del EUSART no está lleno. o

o



TXIF - EUSART Transmit Interrupt Flag bit (bit de la interrupción de transmisión del EUSART) 1 - El búfer de transmisión del EUSART está vacío. El bit se pone a cero al escribir un dato en el registro TXREG. 0 - El búfer de transmisión del EUSART está lleno. o

o



SSPIF - Master Synchronous Serial Port (MSSP) Interrupt Flag bit (bit de bandera de la interrupción de puerto serie síncrono maestro) 1 - Se ha cumplido la condición de ocurrir una interrupción del MSSP al transmitir/ recibir los datos. Difieren dependiendo del modo de operación del MSSP (SPI o I 2C). El bit debe ponerse a cero por software antes de volver de la rutina de servicio de interrupciones) 0 - No se ha cumplido ninguna condición de ocurrir una interrupción del MSSP. o

o



CCP1IF - CCP1 Interrupt Flag bit (bit de bandera de la interrupción del módulo 1 de Comparación/Captura/PWM (CCP1). 1 - Se ha cumplido la condición de la interrupción del CCP1 (CCP1 es una unidad para captar, comparar y generar una señal PWM). Dependiendo del modo de operación (modo captura o modo comparación), se produce una captura o la igualdad en la comparación. En ambos casos, el bit debe volverse a cero por software. El bit no se utiliza en el modo PWM. 0 - No se ha cumplido la condición de la interrupción del CCP1. o

o



TMR2IF - Timer2 to PR2 Interrupt Flag bit (bit de bandera de la interrupción de igual dad entre el temporizador Timer2 y el registro PR2) 1 - Se ha producido igualdad con el valor del TMR2 (registro de 8 bits del temporizador) y el valor del PR2. El bit debe ponerse a cero por software antes de volver de la rutina de servicio de interrupciones). 0 - No se ha producido igualdad con el valor del TMR2 y el valor del PR2. o

o



TMR1IF - Timer1 Overflow Interrupt Flag bit (bit de bandera de la interrupción de desbordamiento del temporizador Timer1) 1 - Se ha producido desbordamiento del Timer1. El bit debe ponerse a cero por software. 0 - No se ha producido desbordamiento del Timer1. o

o

PIR2 (PERIPHERAL INTERRUPT REQUEST REGISTER 2):


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El registro PIR2 contiene los bits de bandera de interrupción. Nota: Los bits de la bandera de interrupción se establecen cuando se produce una condición de alarma, sin importar el estado de su correspondiente bit de habilitación o el Global Enable bit, GIE del registro INTCON. Software El usuario debe asegurarse de los bits de la bandera de interrupción adecuadas son claras antes de activar una interrupción. Las siguientes banderas de interrupción están contenidas en el PIR2 registrarse: • Fail-Safe reloj monitor de interrupción • 2 interrupciones comparadores • EEPROM de datos de escritura de interrupción • Ultra Low-Power despertador de interrupción • Interrupción CCP2 Cuando una interrupción es atendida: • El GIE se borra para inhabilitar cualquier interrupción adicional. • La dirección de retorno se inserta en la pila. • El PC se carga con 0004h. R/W-0 OSFIF Bit 7

R/W-0 C2IF Bit 6

Leyenda R=Readable bit -n= Value at POR

R/W-0 C1IF Bit 5

R/W-0 EEIF Bit 4

R/W-0 BCLIF Bit 3

R/W-0 U-0 R/W-0 ULPWUIF Unimplemented CCP2IF Bit 2 Bit 1 Bit 0

W= Writable Bit U= Uniplemented bit, read as ´0´ ´1´= Bit is set ´0´=Bit is cleared x= Bit unknown

Numero de Bit

Interrupcion

Bit 7

OSFIF: Oscillator Fail Interrupt Flag bit

Bit 6

C2IF: Comparator C2 Interrupt Flag bit

Bit 5

C1IF: Comparator C1 Interrupt Flag bit

Bit 4

EEIF: EE Write Operation Interrupt Flag bit

Bit 3

BCLIF: Bus Collision Interrupt Flag bit

Bit 2

ULPWUIF: Ultra Low-Power Wake-up Interrupt Flag bit

Bit 1

Unimplemented: Read as ‘0’

Bit 0

CCP2IF: CCP2 Interrupt Flag bit

is

bit 7 OSFIF: Oscillator Fail Interrupt Flag bit 1 = System oscillator failed, clock input has changed to INTOSC (must be cleared in software) 0 = System clock operating bit 6 C2IF: Comparator C2 Interrupt Flag bit 1 = Comparator output (C2OUT bit) has changed (must be cleared in software)


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0 = Comparator output (C2OUT bit) has not changed bit 5 C1IF: Comparator C1 Interrupt Flag bit 1 = Comparator output (C1OUT bit) has changed (must be cleared in software) 0 = Comparator output (C1OUT bit) has not changed bit 4 EEIF: EE Write Operation Interrupt Flag bit 1 = Write operation completed (must be cleared in software) 0 = Write operation has not completed or has not started bit 3 BCLIF: Bus Collision Interrupt Flag bit 1 = A bus collision has occurred in the MSSP when configured for I2C Master mode 0 = No bus collision has occurred bit 2 ULPWUIF: Ultra Low-Power Wake-up Interrupt Flag bit 1 = Wake-up condition has occurred (must be cleared in software) 0 = No Wake-up condition has occurred bit 1 Unimplemented: Read as ‘0’

bit 0 CCP2IF: CCP2 Interrupt Flag bit Capture mode: 1 = A TMR1 register capture occurred (must be cleared in software) 0 = No TMR1 register capture occurred Compare mode: 1 = A TMR1 register compare match occurred (must be cleared in software) 0 = No TMR1 register compare match occurred PWM mode: Unused in this mode PCON (POWER CONTROL REGISTER): El Control de Potencia (PCON) registro (ver Registro 2-8) contiene bits de la bandera para diferenciar entre un: • Power-on reset (POR) • Restablecer Brown-out (BOR) • Restablecer Watchdog Timer (WDT) • Restablecer MCLR externo El registro PCON también controla la Ultra Low-Power Wake-up y el software permiten el BOR. Leyenda R=Readable bit -n= Value at POR

W= Writable Bit U= Uniplemented bit, read as ´0´ ´1´= Bit is set ´0´=Bit is cleared x= Bit unknown

Numero de Bit

Interrupcion

Bit 7


Bit 6


Bit 5

ULPWUE: Ultra Low-Power Wake-up Enable bit


is

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Bit 4

SBOREN: Software BOR Enable bit(1)

Bit 3


Bit 2


Bit 1

POR: Power-on Reset Status bit

Bit 0

BOR: Brown-out Reset Status bit

bit 7-6 Unimplemented: Read as ‘0’ bit 5 ULPWUE: Ultra Low-Power Wake-up Enable bit 1 = Ultra Low-Power Wake-up enabled 0 = Ultra Low-Power Wake-up disabled bit 4 SBOREN: Software BOR Enable bit(1) 1 = BOR enabled 0 = BOR disabled bit 3-2 Unimplemented: Read as ‘0’ bit 1 POR: Power-on Reset Status bit 1 = No Power-on Reset occurred 0 = A Power-on Reset occurred (must be set in software after a Power-on Reset occurs) bit 0 BOR: Brown-out Reset Status bit 1 = No Brown-out Reset occurred 0 = A Brown-out Reset occurred (must be set in software after a Brown-out Reset occurs) Note 1: BOREN<1:0> = 01 in the Configuration Word Register 1 for this bit to control the BOR. INTERRUPCIONES PCL y PCLATH El registro llamado PCL, ubicado en la posición 0x02 en el banco de memoria, tiene mucho que ver con el flujo del programa, puesto que le asigna un número a cada línea de código. La primera instrucción, tiene una posición indicada con un número en el registro PCL, cuando se accede a esa posición, se lee la instrucción, se decodifica, y luego se ejecuta, una vez echo esto, el reloj del micro incrementa al contador de programa (PCL) en un unidad, esto hace que el PCL apunte a la segunda instrucción, ahora se lee esta segunda instrucción, se decodifica y también se ejecuta. Nuevamente, el reloj del sistema incrementa el PCL para que apunte a la tercera instrucción, la decodifique y la ejecute. Este proceso se repite hasta que termina el programa, cuando encuentra un END. En si lo que genera es una interrupción de conteo.


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Figura 2.1: Interrupciones de conteo PC.- contador de programa, es de 13 bits de ancho. El byte bajo proviene del registro PCL (Contador de programa en byte bajo), que es un registro de escritura. El byte alto (PCH-Contador de programa en byte alto) (PC <12: 8>) no lee ni escribe y proviene de PCLATH. En cualquier Reset, el PC se borra. Las dos situaciones para cargar PC: 

Por escritura en PCL (PCLATH <4: 0> → PCH).

Por carga al PC durante se Llama (GOTO, CALL) GOTOinstruction (PCLATH <4: 3> → PCH).

Figura 2.2: Funcionamiento de la instrucción GOTO La ejecución de cualquier instrucción con el registro PCL simultáneamente con el Programa Contador de PC <12: 8> bits (PCH) es usado para ser reemplazado por el contenido del registro PCLATH. Esto permite que la totalidad contenido del contador de programa puedan ser cambiados por escribir 5 bits superiores al registro PCLATH. Cuando los 8 bits más bajos se escriben en el registro PCL, todos los 13 bits del contador de programa cambiara los valores contenidos en el registro y los PCLATH se mantendran en el registro PCL. Un GOTO computarizada se logra mediante la adición de un desplazamiento para el contador de programa (ADDWF PCL). Este ejercido salta en una tabla de consulta o tabla de rama programa (GOTO computarizada) modificando el registro PCL. Suponiendo que PCLATH se establece en el mesa de dirección de inicio, si la longitud de la tabla es mayor que 255 instrucciones o si los 8 bits más bajos de la


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memoria dirección de rueda sobre de 0xFF a 0x00 en el medio de la tabla, PCLATH debe incrementarse para cada vuelco dirección que se produce entre la mesa de inicio y la ubicación de destino dentro de la tabla. Interrupciones PIC 18F4550 diferente del PIC 16F887: Interrupción GIE/GIEH: Global Interrupt Enable bit

Función

When IPEN = 0:

1 = Enables all unmasked interrupts 0 = Disables all interrupts 1 = Enables all high priority interrupts 0 = Disables all high priority interrupts

When IPEN = 1:

PEIE/GIEL: Peripheral Interrupt Enable bit When IPEN = 0:

1 = Enables all unmasked peripheral interrupts 0 = Disables all peripheral interrupts

When IPEN = 1:

1 = Enables all low priority peripheral interrupts 0 = Disables all low priority peripheral interrupts

TMR0IE: TMR0 Overflow Interrupt Enable bit

1 = Enables the TMR0 overflow interrupt 0 = Disables the TMR0 overflow interrupt

INT0IE: INT0 External Interrupt Enable bit

1 = Enables the INT0 external interrupt 0 = Disables the INT0 external interrupt

TMR0IF: TMR0 Overflow Interrupt Flag bit INT0IF: INT0 External Interrupt Flag bit

1 = TMR0 register has overflowed (must be cleared in software) 0 = TMR0 register did not overflow 1 = The INT0 external interrupt occurred (must be cleared in software) 0 = The INT0 external interrupt did not occur

INTEDG0: External Interrupt 0 Edge Select bit

1 = Interrupt on rising edge 0 = Interrupt on falling edge




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TMR0IP: TMR0 Overflow Interrupt Priority bit

1 = High priority 0 = Low priority

INT2IP: INT2 External Interrupt Priority bit


INT1IP: INT1 External Interrupt Priority bit

1 = High priority 0 = Low priority Unimplemented: Read as ‘0’


1 = Enables the INT2 external interrupt 0 = Disables the INT2 external interrupt


1 = Enables the INT1 external interrupt 0 = Disables the INT1 external interrupt Unimplemented: Read as ‘0’

INT2IF: INT2 External Interrupt Flag bit

1 = The INT2 external interrupt occurred (must be cleared in software) 0 = The INT2 external interrupt did not occur

INT1IF: INT1 External Interrupt Flag bit

1 = The INT1 external interrupt occurred (must be cleared in software) 0 = The INT1 external interrupt did not occur

SPPIF: Streaming Parallel Port Read/Write Interrupt Flag bit(1)

1 = A read or a write operation has taken place (must be cleared in software) 0 = No read or write has occurred

OSCFIF: Oscillator Fail Interrupt Flag bit

1 = System oscillator failed, clock input has changed to INTOSC (must be cleared in software) 0 = System clock operating

CMIF: Comparator Interrupt Flag bit

1 = Comparator input has changed (must be cleared in software) 0 = Comparator input has not changed

USBIF: USB Interrupt Flag bit

1 = USB has requested an interrupt (must be cleared in software) 0 = No USB interrupt request


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HLVDIF: High/Low-Voltage Detect Interrupt Flag bit

1 = A high/low-voltage condition occurred (must be cleared in software) 0 = No high/low-voltage event has occurred

TMR3IF: TMR3 Overflow Interrupt Flag bit

1 = TMR3 register overflowed (must be cleared in software) 0 = TMR3 register did not overflow

SPPIE: Streaming Parallel Port Read/Write Interrupt Enable bit(1)

1 = Enables the SPP read/write interrupt 0 = Disables the SPP read/write interrupt

OSCFIE: Oscillator Fail Interrupt Enable bit

1 = Enabled 0 = Disabled

CMIE: Comparator Interrupt Enable bit


USBIE: USB Interrupt Enable bit


HLVDIE: High/Low-Voltage Detect Interrupt Enable bit


TMR3IE: TMR3 Overflow Interrupt Enable bit


SPPIP: Streaming Parallel Port Read/Write Interrupt Priority bit(1)


ADIP: A/D Converter Interrupt Priority bit


RCIP: EUSART Receive Interrupt Priority bit


TXIP: EUSART Transmit Interrupt Priority bit


SSPIP: Master Synchronous Serial Port Interrupt Priority bit


CCP1IP: CCP1 Interrupt Priority bit



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TMR2IP: TMR2 to PR2 Match Interrupt Priority bit




OSCFIP: Oscillator Fail Interrupt Priority bit


CMIP: Comparator Interrupt Priority bit


USBIP: USB Interrupt Priority bit


EEIP: Data EEPROM/Flash Write Operation Interrupt Priority bit


BCLIP: Bus Collision Interrupt Priority bit


HLVDIP: High/Low-Voltage Detect Interrupt Priority bit




CCP2IP: CCP2 Interrupt Priority bit


IPEN: Interrupt Priority Enable bit

1 = Enable priority levels on interrupts 0 = Disable priority levels on interrupts (PIC16CXXX Compatibility mode)

SBOREN: BOR Software Enable bit(1)

For details of bit operation, see Register 4-1.

Unimplemented

Read as ‘0’

RI

RESET Instruction Flag bit

INTERRUPCIONES SIMILARES ENTRE LOS PIC 16F887 Y 18F4550

Nombre


Parámetros

Función

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REGISTRO INTCON 16F887

18F4550

INTCON (registro de control de interrupción)

GIE Global Interrupt Enable bit (bit de habilitación de interrupciones globales) GIEH(Interrupciones de alta prioridad) PEIE Peripheral Interrupt Enable bit (bit de habilitación de interrupciones periféricas) GIEL (Interrupciones de baja prioridad)

T0IE - TMR0IE TMR0 Overflow Interrupt Enable bit (bit de habilitación de interrupciones por el desbordamiento del temporizador Timer0)


16f887 INTCON 18F4550 INTCON, INTCON2, INTCON3

Interrupción externa 1 - Interrupciones habilitadas a nivel global 0 - Interrupciones deshabilitadas a nivel global. Interrupción externa 1 - Interrupciones de periféricos deshabilitadas a nivel global 0 - Interrupciones de periféricos habilitadas a nivel global. Interrupción externa 1 - Habilita interrupciones por Timer0. 0 - Deshabilita interrupciones por Timer0.

El registro INTCON contiene varios bits de habilitación y de bandera para el desbordamiento en el registro TMR0, e interrupciones por el cambio del estado en el puerto PORTB y las interrupciones externas en el pin INT Controla simultáneamente todas las fuentes de interrupciones posibles.

Es similar al bit GIE, sin embargo controla interrupciones habilitadas por los periféricos. No influye interrupciones causadas por el temporizador Timer0 o por el cambio del estado en el puerto PORTB o por el cambio en el pin RB0/INT. Controla interrupciones causadas por el desbordamiento del Timer0

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INTE External Interrupt Enable bit (bit de habilitación de la interrupción externa)

RBIE RB Port Change Interrupt Enable bit (bit de habilitación de interrupciones por cambios en el puerto PORTB)

T0IF- TMR0IF TMR0 Overflow Interrupt Flag bit (bit de bandera de interrupción por el desbor damiento del Timer0)

INTF- INT0IF External Interrupt Flag bit (bit de bandera de interrupción externa en INT)

RBIF RB Port Change Interrupt Flag bit (Flag de la interrupción por cambio en el Puerto B)


Interrupción externa 1 - Habilita interrupciones externas INT. 0 - Deshabilita interrupciones externas INT. Interrupción externa 1 - Habilita interrupciones por cambio en el puerto PORTB. 0 - Deshabilita interrupciones por cambio en el puerto PORTB.

Controla interrupciones causadas por el cambio del estado lógico en el pin de entrada RB0/INT en el caso del 16F887, en el caso del 18F4550 los pines de entrada con BR0, RB1, RB2

Cuando se configuran como entradas, los pines en el puerto PORTB pueden causar una interrupción al cambiar el estado lógico. Este bit determina si una interrupción va a ocurrir.

1 - En el registro del Timer0 ha ocurrido desbordamiento (esta bandera debe volverse a 0 por software). 0 - En el registro del Timer0 no ha ocurrido desbordamiento.

Detecta el desbordamiento en el registro del temporizador Timer0, es decir el contador se pone a cero.

Interrupción externa 1 - Ha ocurrido una interrupción externa por INT (esta bandera debe volverse a 0 por software) 0 - No ha ocurrido una interrupción externa por INT.

Detecta el cambio en el estado lógico en el o los pines INT

1 - Al menos uno de los pines de E/S de propósito general en el puerto B ha cambiado de valor. (Después de leer el puerto B, el bit RBIF debe volverse a 0 por

Detecta cualquier cambio del estado lógico de alguno de los pines de entrada en el puerto PORTB.

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software). 0 - Ninguno de los pines de E/S de propósito general en el puerto B ha cambiado de valor. Registro PIE1 (PERIPHERAL INTERRUPT ENABLE REGISTER 1) Contiene los bits de habilitación de interrupciones periféricas. 16f887

18F4550

ADIE A/D Converter Interrupt Enable bit (bit de habilitación de interrupciones del convertidor A/D) RCIE EUSART Receive Interrupt Enable bit (bit de habilitación de interrupciones de recepción del EUSART) TXIE EUSART Transmit Interrupt Enable bit (bit de habilitación de interrupciones de transmisión del EUSART) SSPIE Master Synchronous Serial Port (MSSP) Interrupt Enable bit (bit de habilitación de la interrupción del puerto serie síncrono maestro SÉPTIMO ELECTRÓNICA “A”

1 - Habilita la interrupción ADC. 0 - Deshabilita la interrupción ADC.

Habilita las interrupciones del convertido A/D

1 - Habilita la interrupción de recepción del EUSART. 0 - Deshabilita la interrupción de recepción del EUSART.

Habilita las interrupciones de recepción síncrona EUSART

1 - Habilita la interrupción de transmisión del EUSART. 0 - Deshabilita la interrupción de transmisión del EUSART.

Habilita las interrupciones de transmisión síncrona EUSART

1 - Habilita la interrupción del MSSP. 0 - Deshabilita la interrupción del MSSP.

Habilita generar una petición de interrupción después de cada transmisión de datos por el módulo de comunicación serie síncrona (modo SPI o I2C).

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(MSSP) CCP1IE CCP1 Interrupt Enable bit (bit de habilitación de la interrupción del módulo 1 de Comparación/Captura/PWM - CCP1) TMR2IE TMR2 to PR2 Match Interrupt Enable bit (bit de habilitación de la interrupción de igualdad entre TMR2 y PR2) TMR1IE TMR1 Overflow Interrupt Enable bit (bit de habilitación de la interrupción de desbordamiento del temporizador Timer1)

1 - Habilita la interrupción CCP1. 0 - Deshabilita la interrupción CCP1.

Permite generar una petición de interrupción en el módulo CCP1 utilizado para procesamiento de la señal PWM.

1 - Habilita la interrupción de igualdad entre TMR2 y PR2. 0 - Deshabilita la interrupción de igualdad entre TMR2 y PR2.

Habilita una interrupción si TMR2 y PR2 son iguales

1 - Habilita la interrupción de desbordamiento del temporizador Timer1. 0 - Deshabilita la interrupción de desbordamiento del temporizador Timer1.

Habilita generar una petición de interrupción después de cada desbordamiento en el registro del temporizador Timer1, es decir el contador se pone a cero.

Registro PIE2 (PERIPHERAL INTERRUPT ENABLE REGISTER 2) El registro PIE2 también contiene varios bits de habilitación de interrupciones. 16F887

18F4550

OSFIE Oscillator Fail Interrupt Enable bit (bit de habilitación de la interrupción de fallo en el oscilador) EEIE EEPROM Write Operation SÉPTIMO ELECTRÓNICA “A”

1 - Habilita la interrupción de fallo en el oscilador. 0 - Deshabilita la interrupción de fallo en el oscilador.

Habilita la interrupción si se produce algún tipo de fallo en el oscilador

1 - Habilita la interrupción de escritura

Habilita las interrupciones de escritura en la memoria

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Interrupt Enable bit (bit de habilitación de la interrupción de escritura en la memoria EEPROM)

en la memoria EEPROM. 0 - Deshabilita la interrupción de escritura en la memoria EEPROM.

EEPROM

BCLIE

1 - Habilita la interrupción de colisión de bus. 0 - Deshabilita la interrupción de colisión de bus.

Habilita la interrupción si se produce una colisión en el bus

1 - Habilita la interrupción del CCP2. 0 - Deshabilita la interrupción del CCP2.

Habilita la interrupción del módulo 2 de Comparación/Captura/PWM

Interrupción externa 1 - Interrupción por flanco ascendente 0 - Interrupción por flanco descendente 16f887 Una sola interrupción INTEDG 18F4550 Tres interrupciones: INTEDG0, INTEDG1, INTEDG2

Ejecuta interrupciones externas en dependencia del flanco activo que se configure (subida o bajada)

Bus Collision Interrupt Enable bit (bit de habilitación de la interrupción de colisión de bus) CCP2IE CCP2 Interrupt Enable bit (bit de habilitación de la interrupción del módulo 2 de Comparación/Captura/PWM (CCP2)

INTEDG Interrupt Edge Select bit (bit selector de flanco activo de la interrupción externa)

III) APORTE GRUPAL: Hoy en día los microcontroladores constituyen una gran ventaja, ya que nos permite controlar, programar y sincronizar tareas electrónicas. Existe gran diversidad de microcontroladores, y se puede elegir entre diversas características que uno no tiene pero otro si, como cantidad de puertos, cantidad de entradas y salidas, conversor Analógico- Digital, cantidad de memoria, espacio físico, y este tipo de cualidades que nos permiten tener una mejor elección de este dispositivo. Los microcontroladores cuentan con una gran variedad de aplicaciones, debido a su gran velocidad y tamaño reducido. Cada PIC ayuda a cumplir funciones específicas y es de gran ayuda para los trabajos tecnológicos que se deseen realizar.


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Para la utilización de lo microcontroladores y su programación se debe determinar que fusibles tiene cada PIC y cada interrupción para poder tener un programa óptimo para ser utilizado. IV) BIBLIOGRAFÍA: Henao, C. A., & Duque Cardona, E. (2009). Programando microcontroladores PIC en lenguaje C. Scientia. Greaves, C. (2009). Utilización del PICkit™ 2 Debug Express de MICROCHIP para construir un teremín. Revista española de electrónica, (654), 38-43. Angulo Usategui, J. M., & Martínez, A. (2003). Microcontroladores PIC, Diseño práctico de aplicaciones. Ed. McGraw Hill, 3era edición, Madrid. Pérez, F. E. V., & Areny, R. P. (2007). Microcontroladores: fundamentos y aplicaciones con PIC (Vol. 1149). Marcombo. Ruge, I. A. R. (2008). Método básico para implementar un controlador digital pid en un microcontrolador pic para desarrollo de aplicaciones a bajo costo. GITEINCO Fusagasuga –Colombia. 

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UNIVERSIDAD TÉCNICA DE AMBATO FACULTAD DE INGENIERÍA EN SISTEMAS, ELECTRÓNICA E INDUSTRIAL CARRERA DE ELECTRÓNICA Y COMUNICACIONES 

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Microchip Technology Incorporated (2007). Data Sheet 28/40/44-Pin, Enhanced Flash-Based 8-Bit CMOS microcontrollers with nanoWatt Technology http://ww1.microchip.com/downloads/en/DeviceDoc/41291D.pdf ” Printed in the U.S.A, All Rights Reserved. Fernando E. Valdés Pérez, Ramón Pallás Areny , MICROCONTROLADORES: FUNDAMENTOS Y APLICACIONES CON PIC, MARCOMBO, S.A. 2007. Armando Astarloa Cuéllar, Aizol Zuloaga Izaguierre, SISTEMAS DE PROCESAMIENTO DIGITAL, Jacaryan, S.A. 2008. Cánovas Andrés, Manual CCS Español, Scribd.com, 2014, disponible en: https://es.scribd.com/doc/19658135/Manual-CCS-Espanol. Microchip Technology Inc., PIC 16F/882/883/884/886/887, 2006, Pag. 31-38, disponible en: http://ww1.microchip.com/downloads/en/DeviceDoc/41291F.pdf Microchip Technology Inc., PIC 18F2455/2550/4455/4550, 2006, Pag. 99-111, disponible en: http://ww1.microchip.com/downloads/en/devicedoc/39632c.pdf


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